デュアル・チャンネル・デジタルレシーバ
最終更新日:2015/09/11
このページを印刷高速データの獲得と信号処理が可能
【デュアル・チャンネル・デジタルレシーバ】は、TITS83102 2GS/SのAD変換部、Virtex- 8ミリオン・ゲートのFPGA部、32MBのフラッシュ・メモリのCPU部、Cypress高速シリアル伝送リンクのHOTLINKと160−ピンのVMEバスから構成。各種のSDRアプリケーションに対応可能でカスタムメイド製作も行う。DRFM(デジタルRFメモリ)も用意。
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