アルデック・ジャパン(株)のニュースリリース
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2020/05/07アルデックの新しいHES FPGAアクセラレータボードは、HPC、HFT、およびプロトタイピングアプリケーションを 対象とし、「プライスとパフォーマンス」のスイートスポットを達成
Henderson, USA – 2020年5月4日 – HDL混在言語シミュレーションとFPGAおよびASICのハードウェア・アシステッド・ベリフィケーションのパイオニアであるAldec、Inc.（以下「アルデック」）は、高性能コンピューティング（HPC）、高頻度取引（HFT）アプリケーション、および高速FPGAプロトタイピング用の新しいFPGAアクセラレータボードを発表しました… -
2020/03/31
システムとハードウェアのライフサイクルデータ間の完全なトレーサビリティ
AldecのSpec-TRACER 2020.3リリースは、IBM Requirements Engineering DOORS Nextとの統合を追加することにより、システムとハードウェア開発チーム間のコミュニケーションギャップを埋めます。 Henderson, Nevada, USA – 2020年4月8日 – HDL混在言語シミュレーションとFPGAおよびASICのハードウェア・アシステッド・ベリフィケーションのパイオニ… -
2020/01/30
Cobham Gaislerは、HDLシミュレーションにAldecのRiviera-PROを使用して、初のRISC-VプロセッサであるNOEL-Vの検証に成功しました
Henderson NV, USA - 2020年1月28日 - HDL混在言語シミュレーションとFPGAおよびASICのハードウェア・アシステッド・ベリフィケーションのパイオニアであるAldec、Inc.（以下「アルデック」）は、本日Cobham Gaislerが混在HDLシミュレータRiviera-PROを使用してNOEL-V™と呼ばれる最初のRISC-Vプロセッサの検証に成功したことを発表しました。 NOEL-… -
2019/12/18
アルデック、Riviera-PROのVHDLおよびUVVMサポートを強化
Henderson, USA - 2019年12月17日 – HDL混在言語シミュレーションとFPGAおよびASICのハードウェア・アシステッド・ベリフィケーションのパイオニアであるAldec、Inc.（以下「アルデック」）は、Riviera-PRO ファンクショナルベリフィケーションプラットフォームに最新バージョンのVHDL（2018）およびのUniversal VHDL Verification Methodology（UVV… -
2019/12/13
アルデックの新しいFPGAベースのNVMeデータストレージソリューションは、ハイパフォーマンス・コンピューティング・アプリケーションがターゲット
Henderson, USA - 2019年12月12日 - HDL混在言語シミュレーションとFPGAおよびASICのハードウェア・アシステッド・ベリフィケーションのパイオニアであるAldec、Inc.(以下「アルデック」)は、高頻度取引や機械学習などのハイパフォーマンスコンピューティング(HPC)アプリケーションの開発を支援する、強力かつ多用途で時間を節約することが可能なFPG… -
2019/12/04
SystemVerilogコンストラクトとUVMをサポートするために強化されたAldec Active-HDLの検証機能
Henderson, USA – 2019年12月3日 – HDL混在言語シミュレーションとFPGAおよびASICのハードウェア・アシステッド・ベリフィケーションのパイオニアであるAldec、Inc.(以下「アルデック」)は、FPGAデザイン設計とシミュレーション用Windowsベース統合開発環境(IDE)であるActive-HDLの検証機能を大幅に強化しました 。 これらの拡張機能には、SystemVe… -
2019/11/27
アルデックの最新組込み開発プラットフォームで 業界初シングルボードに最大級のPolarFireおよびSmartFusion2 FPGAを搭載した製品をリリース
Henderson, USA - 2019年11月26日 - HDL混在言語シミュレーションとFPGAおよびASICのハードウェア・アシステッド・ベリフィケーションのパイオニアであるAldec、Inc.（以下「アルデック」）は、Microchip PolarFireまたはSmartFusion2ファミリのいずれかまたは両方のデバイスを使用するFPGAベースの組込システムの開発を支援するHES-MPF500-M2S150開… -
2019/11/15
アルデックは、HES-DVMの自動パーティショニングツールとHDLからFPGAへの コンパイル時間の短縮により、ASICデザインプロトタイプの立ち上げ時間を短縮
Henderson, NV, USA – 2019年9月24日 – HDL混在言語シミュレーションとFPGAおよびASICのハードウェア・アシステッド・ベリフィケーションのパイオニアであるAldec、Inc.（以下「アルデック」）は、SoCおよびASIC設計用の完全自動化およびスケーラブルなハイブリッド検証環境HES-DVM™に自動FPGAパーティショニングを導入しました。 従来はデザインの… -
2019/10/09
アルデックは業界で最も包括的なFMCドーターカードの製品ラインナップを提供
Henderson, NV, USA - 2019年11月14日 - HDL混在言語シミュレーションとFPGAおよびASICのハードウェア・アシステッド・ベリフィケーションのパイオニアであるAldec、Inc.（以下「アルデック」）は、FPGAメザニンカード（FMC）製品ラインを拡張し、IIoT、ネットワーク、エンベデッドビジョン、および自動車分野のさまざまなアプリケーションをサポー… -
2008/06/26
ALINT 2008.06 をリリース
アルデックは、ALINT 2008.06をリリースしたことを発表しました。ALINT 2008.06では、(株)半導体理工学研究センターの「RTL設計スタイルガイド VerilogHDL 編 第2版」から新たに15項目を追加サポートし、合計で195項目のチェックを行うことができます。また、この新バージョンではバイオレーションビューワとコンフィグレーションマネージャという新… -
2008/06/06
Riviera-PRO 2008.06 をリリース
アルデックは、Riviera-PRO 2008.06をリリースしたことを発表しました。この新バージョンではVerilogシミュレーション速度向上、SystemVerilogサポート拡張、単一環境でのSystemCおよびHDL協調デバッグ、SVA,PSL アサーションの波形表示等の機能改善を行いました。Riviera-PROは、SystemC、SystemVerilog によるシステムレベル検証、アサーションベ…
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